Synopsys développe un flux de référence pour l’électronique 2 nm et la photonique avec TSMC
Synopsys et TSMC mettent au point un flux de référence de bout en bout pour l’électronique et la photonique sur silicium, tout en développant une propriété intellectuelle analogique sur la technologie de process 2 nm de TSMC.
Une nouvelle propriété intellectuelle de fondation et d’interface sur le processus N2P à 2 nm est en cours de développement, après une propriété intellectuelle éprouvée sur le processus N3P. Les premières puces numériques pour l’IA construites en 2 nm ont déjà été produites par TSMC.
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Les flux de conception numérique et analogique ont été certifiés sur les technologies de process TSMC N3P et N2 et ont été déployés avec succès par des entreprises dans les domaines de l’IA, du calcul de haute performance et des conceptions mobiles.
Ces flux de conception numérique et analogique utilisent la suite EDA Synopsys.ai sur les nœuds TSMC N3/N3P et N2. Le Synopsys IC Validator permet une signature physique de la puce complète pour gérer la complexité croissante des règles de vérification physique et est maintenant certifié sur les technologies de process TSMC N2 et N3P.
L’IP PHY sur N2 et N2P comprend UCIe, HBM4/3e, 3DIO, PCIe 7.x/6.x, MIPI C/D-PHY et M-PHY, USB, DDR5 MR-DIMM, et LPDDR6/5x. L’IP de base et d’interface pour le N3P comprend 224G Ethernet, UCIe, MIPI C/D-PHY et M-PHY, USB/DisplayPort et eUSB2, LPDDR5x, DDR5, et PCIe 6.x, avec DDR5 MR-DIMM en cours de développement.
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Un nouveau flux est disponible pour la migration TSMC N5 vers N3E, qui vient s’ajouter aux flux établis par Synopsys pour les process TSMC N4P vers N3E et N3E vers N2. En outre, des kits de conception de processus interopérables (iPDK) et des ensembles de runs de vérification physique Synopsys IC Validator sont disponibles pour permettre aux équipes de conception d’effectuer une transition efficace vers les technologies de process avancées de TSMC.
La technologie TSMC Compact Universal Photonic Engine (COUPE) est destinée à répondre aux exigences des conceptions AI et multi-puces à faible latence, à faible consommation d’énergie et à large bande passante.
La collaboration sur la photonique du silicium utilise le compilateur 3DIC et la solution Photonics IC de Synopsys, ainsi que la technologie COUPE de TSMC pour l’IA et les conceptions multi-puces. Le flux couvre la conception de circuits photoniques avec Synopsys OptoCompiler et l’intégration avec des circuits électriques à l’aide de Synopsys 3DIC Compiler et des technologies d’analyse multiphysique d’Ansys.
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Keysight, Synopsys et Ansys ont également présenté un nouveau flux de migration de la conception radiofréquence (RF) intégrée du processus N16 de TSMC vers sa technologie N6RF+. Synopsys cherche actuellement à acquérir Ansys.
« Les avancées dans les flux EDA prêts à la production de Synopsys et l’intégration de la photonique avec notre compilateur 3DIC, qui prend en charge le standard 3Dblox, combinés à un large portefeuille d’IP permettent à Synopsys et TSMC d’aider les concepteurs à atteindre le prochain niveau d’innovation pour leurs conceptions de puces sur les processus avancés de TSMC « , a déclaré Sanjay Bali, vice-président de la stratégie et de la gestion des produits pour le groupe EDA chez Synopsys.
« La confiance profonde que nous avons bâtie au fil de décennies de collaboration avec TSMC a fourni à l’industrie des solutions EDA et IP critiques qui offrent une qualité de résultats convaincante et des gains de productivité avec une migration plus rapide d’un nœud à l’autre. »
« Notre étroite collaboration avec les partenaires de l’écosystème Open Innovation Platform (OIP) tels que Synopsys a permis aux clients de répondre aux exigences de conception les plus difficiles, toutes à la pointe de l’innovation, des dispositifs à l’échelle de l’angström aux systèmes multi-pièces complexes dans une gamme de conceptions informatiques à haute performance », a déclaré Dan Kochpatcharin, responsable de la division Design Infrastructure Management chez TSMC.
https://www.synopsys.com/designware-ip.html
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