{"id":481888,"date":"2025-06-20T09:50:12","date_gmt":"2025-06-20T07:50:12","guid":{"rendered":"https:\/\/www.ecinews.fr\/?p=481888"},"modified":"2025-06-20T10:11:27","modified_gmt":"2025-06-20T08:11:27","slug":"imec-en-belgique-annonce-un-can-a-150-gb-s","status":"publish","type":"post","link":"https:\/\/www.ecinews.fr\/fr\/imec-en-belgique-annonce-un-can-a-150-gb-s\/","title":{"rendered":"Imec en Belgique annonce un CAN CMOS FinFET \u00e0 150 Gb\/s"},"content":{"rendered":"

La soci\u00e9t\u00e9 imec, bas\u00e9e \u00e0 Louvain, en Belgique, a annonc\u00e9 une perc\u00e9e importante dans le domaine de la conception analogique : un convertisseur num\u00e9rique-analogique (CNA) de 7 bits et de 150 giga-\u00e9chantillons par seconde (GSa\/s) visant jusqu’\u00e0 300 Gb\/s par voie en utilisant la modulation PAM-4. Cela ouvre la voie \u00e0 des interconnexions beaucoup plus rapides dans les centres de donn\u00e9es et les architectures informatiques \u00e0 grande \u00e9chelle, indique l’<\/a>imec.<\/p>\n

Construit sur la plateforme CMOS FinFET 5 nm avanc\u00e9e d’imec<\/a>, le DAC r\u00e9pond aux d\u00e9fis croissants de la conception de liaisons \u00e0 haut d\u00e9bit. Alors que les charges de travail de l’IA et du cloud deviennent de plus en plus gourmandes en donn\u00e9es, les solutions existantes de conversion analogique-num\u00e9rique et num\u00e9rique-analogique ont eu du mal \u00e0 suivre le rythme sans faire exploser les compromis en mati\u00e8re de puissance, de latence et d’int\u00e9grit\u00e9 du signal.<\/p>\n

Peter Ossieur, responsable du programme d’\u00e9metteurs-r\u00e9cepteurs \u00e0 grande vitesse de l’imec, a soulign\u00e9 que la nouvelle puce repr\u00e9sente une combinaison convaincante de vitesse et d’efficacit\u00e9 \u00e9nerg\u00e9tique – une raret\u00e9 \u00e0 ce niveau de performance. Il a expliqu\u00e9 que la conception \u00ab\u00a0vise des d\u00e9bits de donn\u00e9es sup\u00e9rieurs \u00e0 200 Gb\/s et atteignant finalement 400 Gb\/s par voie\u00a0\u00bb, notant l’utilisation de CMOS FinFET de 5 nm comme une n\u00e9cessit\u00e9 pour permettre une telle performance.<\/p>\n

\"micrographie

Micrographie de la puce contenant deux canaux DAC. (Source : imec<\/a>)<\/p><\/div>\n

Un premier jalon \u00e0 150 GSa\/s\u00a0<\/h2>\n

L’Europe a pris du retard dans le d\u00e9veloppement de DAC et ADC de pointe par rapport aux \u00c9tats-Unis et aux acteurs asiatiques. L’annonce de l’Imec est un signal strat\u00e9gique : la recherche et la conception nationales peuvent suivre le rythme des demandes mondiales des \u00e9quipementiers en mati\u00e8re d’interconnexions de donn\u00e9es \u00e0 tr\u00e8s grande \u00e9chelle. Les 150 GSa\/s constituent une \u00e9tape importante. Alors qu’il n’\u00e9tait auparavant r\u00e9alisable que dans des laboratoires d’int\u00e9gration verticale ou par des proc\u00e9d\u00e9s propri\u00e9taires, le prototype d’Imec permet d\u00e9sormais d’atteindre cette capacit\u00e9 dans le CMOS FinFET courant.<\/p>\n

Le contexte du DAC est crucial. Associ\u00e9e \u00e0 une horloge \u00e0 faible gigue au niveau de la femto seconde et \u00e0 la signalisation PAM-4, la conception analogique r\u00e9pond \u00e0 l’\u00e9volution de l’industrie vers les liaisons \u00e0 plusieurs voies, 400 GbE et au-del\u00e0. Ainsi, ce dispositif peut servir de base aux futurs convertisseurs 300-400 GSa\/s destin\u00e9s aux liaisons \u00e0 bande passante de 100 GHz.<\/p>\n

Pour les \u00e9quipes de conception analogique et les fabricants de semi-conducteurs europ\u00e9ens, cette avanc\u00e9e repr\u00e9sente une opportunit\u00e9. L’expertise d’imec en mati\u00e8re de process et d’architecture peut d\u00e9sormais \u00e9tayer les ASIC de SerDes et d’\u00e9metteurs-r\u00e9cepteurs optiques de la prochaine g\u00e9n\u00e9ration. Dans le m\u00eame temps, les concurrents mondiaux s’orientent vers des structures de commutation \u00e0 56 Tbit\/s, des acc\u00e9l\u00e9rateurs d’intelligence artificielle et des processeurs exa-scales, qui exigent tous des E\/S ultra-efficaces et \u00e0 grande vitesse.<\/p>\n

Conception de la puce de l’UE<\/h2>\n

Le pivot r\u00e9oriente la conception des puces europ\u00e9ennes. L’accent n’est plus mis sur les licences de propri\u00e9t\u00e9 intellectuelle et les processus h\u00e9rit\u00e9s, mais sur l’innovation en mati\u00e8re de signaux mixtes \u00e0 grande vitesse, cruciale pour l’infrastructure de donn\u00e9es de la prochaine g\u00e9n\u00e9ration. Questions cl\u00e9s pour les dirigeants : Qui int\u00e9grera ce DAC en premier ? Et comment \u00e9volueront la mise \u00e0 l’\u00e9chelle pour la production de masse et le co\u00fbt par puce ?<\/p>\n

La d\u00e9claration de l’imec selon laquelle les prochaines \u00e9tapes consisteront \u00e0 \u00ab\u00a0doubler le taux d’\u00e9chantillonnage \u00e0 300 GSa\/s et \u00e0 pousser la bande passante au-del\u00e0 de 100 GHz\u00a0\u00bb \u00e9tablit une trajectoire claire. Pour les ing\u00e9nieurs professionnels qui travaillent sur des interfaces analogiques \u00e0 grande vitesse, il s’agit d’une rare conception de r\u00e9f\u00e9rence ancr\u00e9e dans le monde r\u00e9el et issue de la recherche et du d\u00e9veloppement europ\u00e9ens. Pour les dirigeants, c’est le signe que l’Europe peut encore produire des IP analogiques de premier plan – sur des n\u0153uds avanc\u00e9s et avec des gains de d\u00e9bit concrets.<\/p>\n

Plus d’informations : imec<\/a><\/p>\n","protected":false},"excerpt":{"rendered":"

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