{"id":440520,"date":"2024-01-05T15:40:06","date_gmt":"2024-01-05T14:40:06","guid":{"rendered":"https:\/\/www.eenewseurope.com\/?p=440520"},"modified":"2024-01-07T21:51:02","modified_gmt":"2024-01-07T20:51:02","slug":"sameer-wasson-de-mips-sur-le-redemarrage-sous-risc-v","status":"publish","type":"post","link":"https:\/\/www.ecinews.fr\/fr\/sameer-wasson-de-mips-sur-le-redemarrage-sous-risc-v\/","title":{"rendered":"Sameer Wasson de MIPS mise sur le red\u00e9marrage de RISC-V"},"content":{"rendered":"

MIPS Inc. est en train de devenir un important fournisseur de licences de c\u0153urs de processeurs RISC-V sous la houlette de son PDG Sameer Wasson, r\u00e9cemment nomm\u00e9. eeNews Europe\/ECInews<\/em> a interrog\u00e9 M. Wasson pour savoir comment il compte naviguer dans les eaux agit\u00e9es d’un march\u00e9 des processeurs en pleine mutation.<\/h2>\n

MIPS a \u00e9t\u00e9 fond\u00e9e aux USA en 1984 et a \u00e9t\u00e9 l’un des pionniers de la premi\u00e8re r\u00e9volution RISC dans l’architecture des processeurs. Cela a permis \u00e0 l’entreprise de traverser les ann\u00e9es 1990, o\u00f9 elle s’est retrouv\u00e9e face \u00e0 une startup britannique appel\u00e9e Arm. L’accent mis par Arm sur l’efficacit\u00e9 \u00e9nerg\u00e9tique lui a permis de s’emparer du march\u00e9 des smartphones et de larges pans des march\u00e9s g\u00e9n\u00e9raux de l’embarqu\u00e9. MIPS \u00e9tait davantage ax\u00e9 sur les performances. Elle a commenc\u00e9 par fournir des processeurs pour stations de travail et a obtenu de bons r\u00e9sultats dans le domaine des r\u00e9seaux et des communications. Elle a ensuite connu une s\u00e9rie d’acquisitions et de ventes d’entreprises avant d’\u00eatre majoritairement d\u00e9tenue par Tallwood Ventures, avec pour mission de poursuivre ses activit\u00e9s de concession de licences de processeurs bas\u00e9s sur l’architecture RISC-V \u00e0 code source ouvert.<\/p>\n

Wasson a rejoint la soci\u00e9t\u00e9 en septembre 2023 apr\u00e8s avoir quitt\u00e9 Texas Instruments (voir MIPS pour favoriser la p\u00e9n\u00e9tration du march\u00e9 RISC-V et l’innovation<\/a>). Il y \u00e9tait responsable des microcontr\u00f4leurs et des processeurs \u00e0 haute performance. \u00ab\u00a0J’ai pu constater que RISC-V avait un grand potentiel et qu’il offrait la possibilit\u00e9 de redonner le contr\u00f4le aux ing\u00e9nieurs. Je consid\u00e8re MIPS comme une startup \u00e2g\u00e9e de 40 ans, ou une startup qui red\u00e9marre. En fait, l’entreprise s’orientait d\u00e9j\u00e0 vers RISC-V depuis 2018-2019.\u00a0\u00bb<\/p>\n

Recommencer comme une startup<\/h4>\n

Etant en mode \u00ab\u00a0red\u00e9marrage\u00a0\u00bb, MIPS a l’avantage de recevoir des redevances de la part des d\u00e9tenteurs de licences de ses c\u0153urs de processeurs historiques MIPS \u00e0 architecture de jeux d’instructions (ISA). Il permet \u00e9galement d’asseoir les relations avec les clients. En tant que soci\u00e9t\u00e9 priv\u00e9e, MIPS n’est pas tenue de r\u00e9v\u00e9ler les d\u00e9tails de son chiffre d’affaires sur une base trimestrielle, mais M. Wasson a d\u00e9clar\u00e9 que la soci\u00e9t\u00e9 se r\u00e9partissait \u00e0 peu pr\u00e8s \u00e0 parts \u00e9gales entre les redevances MIPS ISA et les droits de licence initiaux pour le prochain c\u0153ur RISC-V \u00e0 hautes performances de MIPS, le P8700. La plupart des fournisseurs de c\u0153urs de processeurs RISC-V sont des soci\u00e9t\u00e9s priv\u00e9es, ce qui rend difficile l’estimation des ventes, mais M. Wasson estime que MIPS est d\u00e9j\u00e0 l’un des deux ou trois principaux conc\u00e9dants de licences RISC-V.<\/p>\n

M. Wasson a d\u00e9clar\u00e9 que la philosophie de MIPS est de prendre les \u00e9l\u00e9ments que l’ISA originale de MIPS fait bien et de les refondre en utilisant l’ISA de base de RISC-V et l’extensibilit\u00e9 sous RISC-V. Cela permet aux d\u00e9tenteurs de licences MIPS existantes de se mettre \u00e0 niveau et aux nouveaux clients d’acc\u00e9der \u00e0 certaines applications.<\/p>\n

Nous ne voulons pas essayer de \u00ab\u00a0faire bouillir l’oc\u00e9an\u00a0\u00bb et de nous attaquer \u00e0 Arm. Le syst\u00e8me MIPS est performant sur certains points et nous nous concentrons donc sur ceux-ci\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. Il donne l’exemple d’une circulation efficace des donn\u00e9es dans le cadre de l’ISA MIPS, qui s’est traduite par l’octroi de licences pour les r\u00e9seaux et les modems, ainsi que pour certaines applications automobiles. \u00ab\u00a0Cette capacit\u00e9 est utilis\u00e9e pour les r\u00e9seaux de centres de donn\u00e9es, la gestion du trafic et les applications DPU\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson.<\/p>\n

Dans le cas de l’automobile, MIPS fait partie de l’offre de Mobileye depuis de nombreuses g\u00e9n\u00e9rations de processeurs ADAS. \u00ab\u00a0Nous avons Mobileye comme client RISC-V et aussi quelques hyperscalers, que nous ne pouvons pas nommer\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. Il a ajout\u00e9 qu’avec le temps, la capacit\u00e9 de mise en r\u00e9seau du MIPS est devenue pertinente pour un plus grand nombre d’applications.<\/p>\n

Le nouveau processeur P8700<\/h4>\n

\u00ab\u00a0Notre processeur RISC-V est un processeur de type MIPS, multithread, qui prend en charge la virtualisation mat\u00e9rielle et la coh\u00e9rence de la m\u00e9moire cache\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. Il affirme que ces performances \u00e9lev\u00e9es et ce soutien \u00e0 la s\u00e9curit\u00e9 trouvent leur place dans des domaines tels que les syst\u00e8mes d’aide \u00e0 la conduite (ADAS) et les r\u00e9seaux intra-v\u00e9hiculaires, la combinaison des syst\u00e8mes d’aide \u00e0 la conduite et d’info-divertissement, d’o\u00f9 l’engagement de Mobileye.<\/p>\n

En outre, M. Wasson estime que l’utilisation croissante de l’\u00e9lectronique dans les v\u00e9hicules – qu’ils soient \u00e9lectriques ou \u00e0 moteur \u00e0 combustion interne – entra\u00eenera un besoin accru de mises \u00e0 jour en direct. \u00ab\u00a0Les calculateurs devront \u00eatre capables de fonctionner en temps r\u00e9el et de g\u00e9rer des environnements multiples\u00a0\u00bb, a-t-il d\u00e9clar\u00e9.<\/p>\n

Le P8700, un processeur RISC-V 64 bits superscalaire \u00e0 fonctionnement \u00ab\u00a0hors ordre\u00a0\u00bb, devrait \u00eatre commercialis\u00e9 \u00e0 la fin du premier trimestre de l’ann\u00e9e 24, a indiqu\u00e9 M. Wasson. \u00ab\u00a0Il est disponible sous la forme d’un r\u00e9seau sur puce (NoC) coh\u00e9rent et \u00e9volutif, dot\u00e9 d’un cache multic\u0153ur. Il est \u00e9galement disponible en grappes multiples. Il d\u00e9marre sous Linux et sera accompagn\u00e9 d’une documentation permettant de l’inclure dans un SoC et sera \u00e9galement certifi\u00e9 en mati\u00e8re de s\u00e9curit\u00e9\u00a0\u00bb, a-t-il ajout\u00e9.<\/p>\n

La conception vise initialement le processus de fabrication 7nm de TSMC, bien que les ing\u00e9nieurs de MIPS travaillent \u00e0 aller au-del\u00e0, a d\u00e9clar\u00e9 M. Wasson. \u00ab\u00a0Il se peut que nous ayons \u00e9galement une optimisation en 16 nm. M. Wasson a d\u00e9clar\u00e9 qu’au moment du lancement, le P8700 sera l’un des c\u0153urs de processeur RISC-V les plus performants disponibles.<\/p>\n

Pour et contre ?<\/h4>\n

En tant qu’architecture \u00e0 code source ouvert, RISC-V est disponible pour une utilisation libre de droits et s’accompagne d’un support pour l’extension du jeu d’instructions et la mise en \u0153uvre de la conception par tous les participants. Toutefois, ces auteurs peuvent toujours conc\u00e9der des licences pour leurs impl\u00e9mentations sp\u00e9cifiques et facturer l’assistance technique. Il s’agit l\u00e0 d’une diff\u00e9rence majeure par rapport \u00e0 l’architecture d’Arm, qui est propri\u00e9taire et rigoureusement contr\u00f4l\u00e9e par l’entreprise britannique.<\/p>\n

Mais l’ouverture peut-elle \u00eatre \u00e0 la fois un avantage et un obstacle pour les utilisateurs de RISC-V ? La personnalisation permise par RISC-V facilite l’optimisation des performances, de l’efficacit\u00e9 \u00e9nerg\u00e9tique et d’autres param\u00e8tres, mais cela pourrait \u00e0 son tour entra\u00eener une fragmentation du march\u00e9 qui inhiberait le soutien de l’\u00e9cosyst\u00e8me ou le rendrait plus co\u00fbteux.<\/p>\n

Wasson voit les choses diff\u00e9remment. \u00ab\u00a0RISC-V permet de prendre le meilleur des deux cas. Vous disposez d’une conformit\u00e9 de base en mati\u00e8re de d\u00e9bogage, de tra\u00e7age et de normes d\u00e8s la sortie de la bo\u00eete. Il existe une norme qui assure l’interop\u00e9rabilit\u00e9. Mais vous pouvez ensuite r\u00e9gler les c\u0153urs – comme vous le faites ailleurs – pour la performance, la puissance ou le mouvement des donn\u00e9es.<\/p>\n

L’\u00e9l\u00e9phant de l’IA<\/h4>\n

En 2024, l’intelligence artificielle est l’\u00e9l\u00e9phant qui se trouve dans les laboratoires de recherche et de d\u00e9veloppement de presque toutes les entreprises technologiques. Le traitement ou l’acc\u00e9l\u00e9ration de l’IA fait-il partie de la feuille de route de MIPS ?<\/em><\/p>\n

\u00ab\u00a0Nous aborderons l’IA en nous assurant que nous disposons du meilleur processeur pour le d\u00e9placement des donn\u00e9es\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson, indiquant qu’il voit un march\u00e9 important dans la prise en charge des GPU et des acc\u00e9l\u00e9rateurs d’IA dans les serveurs pour le centre de donn\u00e9es. \u00ab\u00a0MIPS peut offrir l’inf\u00e9rence \u00e0 terme, mais il y a une exigence de l’\u00e9cosyst\u00e8me [that needs to settle] et j’attendrai sur ce point\u00a0\u00bb, a-t-il ajout\u00e9.<\/p>\n

\u00ab\u00a0La perspective logicielle est prioritaire, mais il sera toujours pr\u00e9f\u00e9rable d’aborder les choses au niveau de l’ISA. Et les ing\u00e9nieurs ne veulent pas avoir \u00e0 g\u00e9rer plusieurs ISA\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. L’un des probl\u00e8mes est que l’IA est encore relativement immature en termes de d\u00e9veloppement et qu’elle a un probl\u00e8me de consommation d’\u00e9nergie, a expliqu\u00e9 M. Wasson.<\/p>\n

Le mat\u00e9riel d’IA a jusqu’\u00e0 pr\u00e9sent \u00e9t\u00e9 optimis\u00e9 pour la g\u00e9n\u00e9ralit\u00e9 et la performance, affirme-t-il. \u00ab\u00a0Nous devons augmenter le nombre de traitements sans faire exploser la consommation d’\u00e9nergie. L’IA n’a pas encore \u00e9t\u00e9 con\u00e7ue avec le budget \u00e9nerg\u00e9tique comme premi\u00e8re contrainte\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. Lorsqu’elle est con\u00e7ue de cette mani\u00e8re, M. Wasson indique que RISC-V est un choix convaincant.<\/p>\n

Paysage concurrentiel<\/h4>\n

Un autre aspect de la nature open-source de RISC-V est qu’il est beaucoup plus comp\u00e9titif qu’un \u00e9cosyst\u00e8me ISA propri\u00e9taire. De nombreuses entreprises proposent d\u00e9j\u00e0 des c\u0153urs de processeurs et soutiennent les entreprises de fabrication de puces sans fil dans leur mise en \u0153uvre. En revanche, Arm est, dans la plupart des cas, un fournisseur monopolistique autour de sa propre ISA.<\/p>\n

Dans le cadre de cette comp\u00e9tition, MIPS recrute et les cadres sup\u00e9rieurs Drew Barbier et Brad Burgess ont d\u00e9j\u00e0 rejoint l’\u00e9quipe dirigeante de MIPS. Tous deux travaillaient auparavant chez SiFive, pionnier du RISC-V. Barbier rejoint MIPS en tant que vice-pr\u00e9sident des produits et Burgess en tant qu’architecte en chef (voir MIPS recrute d’anciens cadres sup\u00e9rieurs de SiFive pour stimuler le jeu RISC-V<\/a>).<\/p>\n

\u00ab\u00a0RISC-V est un espace tr\u00e8s actif. Et je m’attends \u00e0 ce que d’autres concurrents se manifestent\u00a0\u00bb, a d\u00e9clar\u00e9 M. Wasson. \u00ab\u00a0Je ne vois pas cela comme une chose n\u00e9gative. Il faut de la concurrence pour faire ressortir le meilleur de l’ing\u00e9nierie. Mais si nous avons les bonnes bases, tout d\u00e9pend de notre capacit\u00e9 \u00e0 les mettre en \u0153uvre\u00a0\u00bb, a conclu M. Wasson.<\/p>\n

Liens et articles connexes :<\/h4>\n

www.mips.com<\/a><\/p>\n

Articles de presse :<\/h4>\n

SiFive licencie 20 % de son personnel et r\u00e9oriente ses activit\u00e9s<\/a><\/p>\n

MIPS stimule la p\u00e9n\u00e9tration du march\u00e9 RISC-V et l’innovation<\/a><\/p>\n

MIPS recrute d’anciens cadres sup\u00e9rieurs de SiFive pour stimuler le jeu RISC-V<\/a><\/p>\n

Codasip livre le premier processeur commercial CHERI utilisant RISC-V <\/a><\/p>\n","protected":false},"excerpt":{"rendered":"

MIPS Inc. est en train de devenir un important fournisseur de licences de c\u0153urs de processeurs RISC-V sous la houlette de son PDG Sameer Wasson, r\u00e9cemment nomm\u00e9. eeNews Europe\/ECInews a interrog\u00e9 M. Wasson pour savoir comment il compte naviguer dans les eaux agit\u00e9es d’un march\u00e9 des processeurs en pleine mutation. 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