{"id":433164,"date":"2023-09-27T20:57:35","date_gmt":"2023-09-27T18:57:35","guid":{"rendered":"https:\/\/www.eenewseurope.com\/?p=433164"},"modified":"2023-09-27T21:00:14","modified_gmt":"2023-09-27T19:00:14","slug":"les-outils-de-synopsys-produisent-des-puces-2-nm-chez-tsmc","status":"publish","type":"post","link":"https:\/\/www.ecinews.fr\/fr\/les-outils-de-synopsys-produisent-des-puces-2-nm-chez-tsmc\/","title":{"rendered":"Les outils de Synopsys produisent des puces 2 nm chez TSMC"},"content":{"rendered":"<h3>Synopsys indique que des clients ont fabriqu\u00e9 plusieurs puces sur le process 2 nm de TSMC, qui certifie les flux de conception analogiques et num\u00e9riques.<\/h3>\n<p>Synopsys indique que le flux de conception num\u00e9rique pour le process TSMC 2nm N2 nanosheet est en train de r\u00e9aliser plusieurs tape-outs et que le flux de conception analogique a \u00e9t\u00e9 adopt\u00e9 pour plusieurs d\u00e9marrages de conception. Les \u00e9chantillons sont attendus en 2024.<\/p>\n<p>Il s&rsquo;agit d&rsquo;une avanc\u00e9e significative pour que les flux et les biblioth\u00e8ques de conception analogique soient disponibles en m\u00eame temps que les flux et les biblioth\u00e8ques de conception num\u00e9rique sur le process de pointe, en particulier avec le passage des transistors FINFET \u00e0 des dispositifs \u00e0 nano-feuillets et Gate All Aound (GAA). Cela n\u00e9cessite de nouveaux outils de conception et de validation, qui ont \u00e9t\u00e9 d\u00e9velopp\u00e9s avec Ansys et Keysight Technologies.<\/p>\n<p>Les flux de conception utilisent la suite EDA compl\u00e8te de Synopsys.ai, pilot\u00e9e par l&rsquo;IA, avec une interface IP en cours de d\u00e9veloppement pour r\u00e9duire les risques lors de l&rsquo;int\u00e9gration et acc\u00e9l\u00e9rer les d\u00e9lais. Cette technologie est destin\u00e9e aux PC \u00e0 haute performance, \u00e0 l&rsquo;IA et aux SoC mobiles.<\/p>\n<ul>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/tsmc-says-2nm-on-track-for-2025-as-it-broadens-3nm-offer\/\">TSMC annonce que le 2nm est en bonne voie pour 2025 et \u00e9largit son offre de 3nm<\/a><\/li>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/tsmc-shows-2nm-nanosheet-transistor-plans-for-2025-production\/\">TSMC pr\u00e9sente ses projets de transistors \u00e0 feuillets nanom\u00e9triques de 2 nm pour 2025<\/a><\/li>\n<\/ul>\n<p>Les technologies de conception pilot\u00e9es par l&rsquo;IA, notamment DSO.ai de Synopsys, sont utilis\u00e9es pour optimiser les conceptions N2 en 2 nm afin d&rsquo;am\u00e9liorer la puissance consomm\u00e9e, les performances et la surface utilis\u00e9e.<\/p>\n<p>\u00ab\u00a0La collaboration de longue date entre TSMC et Synopsys se caract\u00e9rise par une grande qualit\u00e9 des r\u00e9sultats et une mise sur le march\u00e9 plus rapide des conceptions SoC avanc\u00e9es\u00a0\u00bb, a d\u00e9clar\u00e9 Dan Kochpatcharin, responsable de la division Design Infrastructure Management chez TSMC.<\/p>\n<p>\u00ab\u00a0Nous travaillons en \u00e9troite collaboration avec nos partenaires de l&rsquo;\u00e9cosyst\u00e8me de conception tels que Synopsys afin de fournir un \u00e9ventail complet de solutions de premier ordre pour les technologies de process les plus avanc\u00e9es de TSMC, offrant \u00e0 nos clients mutuels un avantage clair pour r\u00e9pondre aux exigences de silicium des applications de haute performance, ainsi qu&rsquo;une voie \u00e9prouv\u00e9e pour migrer rapidement leurs conceptions d&rsquo;un n\u0153ud \u00e0 l&rsquo;autre.\u00a0\u00bb<\/p>\n<p>\u00ab\u00a0Les flux de conception num\u00e9rique et analogique de Synopsys pour le process TSMC N2 repr\u00e9sentent un investissement significatif de Synopsys sur l&rsquo;ensemble de la pile EDA, aidant les concepteurs \u00e0 d\u00e9marrer leurs conceptions N2, \u00e0 diff\u00e9rencier leurs SoC avec une puissance, des performances et une densit\u00e9 de puce de plus en plus \u00e9lev\u00e9es, et \u00e0 acc\u00e9l\u00e9rer leur temps de mise sur le march\u00e9 \u00ab\u00a0, a d\u00e9clar\u00e9 Sanjay Bali, vice-pr\u00e9sident de la strat\u00e9gie et de la gestion des produits pour le groupe EDA chez Synopsys. \u00ab\u00a0Notre \u00e9troite collaboration avec TSMC \u00e0 travers toutes les g\u00e9n\u00e9rations de technologies de traitement de TSMC nous permet de fournir des solutions EDA et IP in\u00e9gal\u00e9es dont les clients ont besoin pour innover et renforcer leur avantage concurrentiel.\u00a0\u00bb<\/p>\n<p>Le flux analogique de Synopsys permet une r\u00e9utilisation efficace des conceptions d&rsquo;un n\u0153ud \u00e0 l&rsquo;autre sur les process avanc\u00e9s de TSMC. Dans le cadre des flux EDA certifi\u00e9s, Synopsys fournit des kits de conception de processus interop\u00e9rables (iPDK) et la v\u00e9rification physique Synopsys IC Validator pour la signature physique de la puce compl\u00e8te.<\/p>\n<ul>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/synopsys-adds-generative-ai-data-analytics-across-its-eda-and-fab-tools\/\">Synopsys ajoute l&rsquo;analyse g\u00e9n\u00e9rative des donn\u00e9es d&rsquo;IA \u00e0 ses outils EDA<\/a><\/li>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/ansys-tools-tackle-reliability-of-2nm-nanosheet-transistors\/\">Les outils Ansys s&rsquo;attaquent \u00e0 la fiabilit\u00e9 des transistors \u00e0 feuillets nanom\u00e9triques de 2 nm<\/a><\/li>\n<\/ul>\n<p>Un flux de r\u00e9f\u00e9rence de conception RF a \u00e9t\u00e9 d\u00e9velopp\u00e9 avec Ansys et Keysight pour le process TSMC N4P RF FinFET avec un iPDK interop\u00e9rable qui fonctionne jusqu&rsquo;\u00e0 2nm.<\/p>\n<p>Le flux de migration de la conception analogique peut \u00eatre utilis\u00e9 pour les technologies de process N4P, N3E et N2. Le flux de migration des conceptions analogiques, qui fait partie de la famille Synopsys Custom Design, comprend une solution de migration de sch\u00e9mas et de mod\u00e8les bas\u00e9e sur l&rsquo;apprentissage automatique pour acc\u00e9l\u00e9rer les t\u00e2ches globales de migration des conceptions analogiques.<\/p>\n<p>Ces outils int\u00e8grent une optimisation pilot\u00e9e par l&rsquo;IA et tenant compte des parasites, ce qui permet de surmonter les efforts manuels et it\u00e9ratifs g\u00e9n\u00e9ralement n\u00e9cessaires pour mettre au point les conceptions analogiques afin qu&rsquo;elles r\u00e9pondent \u00e0 toutes les sp\u00e9cifications. Gr\u00e2ce \u00e0 ce flux, les ing\u00e9nieurs peuvent optimiser leur conception dans le nouveau n\u0153ud technologique tout en gagnant des semaines sur le temps et les efforts d&rsquo;ing\u00e9nierie.<\/p>\n<p>\u00ab\u00a0L&rsquo;augmentation de la complexit\u00e9 des puces, les contraintes en mati\u00e8re de ressources d&rsquo;ing\u00e9nierie et le resserrement des d\u00e9lais de livraison incitent les entreprises \u00e0 recourir \u00e0 des solutions pilot\u00e9es par l&rsquo;IA afin d&rsquo;acc\u00e9l\u00e9rer la qualit\u00e9 des r\u00e9sultats et les d\u00e9lais d&rsquo;obtention des r\u00e9sultats\u00a0\u00bb, a d\u00e9clar\u00e9 M. Bali.<\/p>\n<p>\u00ab\u00a0Notre collaboration avec TSMC sur le flux de migration des conceptions analogiques pour les process N4P, N3E et N2 de TSMC permet \u00e0 nos clients mutuels de r\u00e9aliser des gains de productivit\u00e9 consid\u00e9rables gr\u00e2ce \u00e0 une migration efficace de leurs conceptions d&rsquo;un n\u0153ud \u00e0 l&rsquo;autre.<\/p>\n<p>Les flux EDA certifi\u00e9s sont disponibles d\u00e8s maintenant.<\/p>\n<p>www.synopsys.com <a href=\"http:\/\/www.synopsys.com\">;<\/a> <a href=\"http:\/\/www.tsmc.com\">www.tsmc.com<\/a><\/p>\n<h4>Autres articles sur le 2 nm<\/h4>\n<ul>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/siemens-eda-certifies-calibre-fastspice-for-tsmc-2nm\/\">Siemens EDA certifie Calibre et FastSPICE pour TSMC 2nm<\/a><\/li>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/cadence-uses-ai-to-automate-move-to-3nm-and-2nm-technologies\/\">Cadence utilise l&rsquo;IA pour automatiser le passage au 3 nm et au 2 nm<\/a><\/li>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/japan-us-make-plans-for-independent-2nm-production\/\">Le Japon et les \u00c9tats-Unis envisagent une production ind\u00e9pendante de pi\u00e8ces de 2 nm<\/a><\/li>\n<\/ul>\n<p>&nbsp;<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Synopsys indique que des clients ont fabriqu\u00e9 plusieurs puces sur le process 2 nm de TSMC, qui certifie les flux de conception analogiques et num\u00e9riques. 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