{"id":429689,"date":"2023-08-16T16:11:47","date_gmt":"2023-08-16T14:11:47","guid":{"rendered":"https:\/\/www.eenewseurope.com\/?p=429689"},"modified":"2023-08-16T16:11:47","modified_gmt":"2023-08-16T14:11:47","slug":"tachyum-fait-passer-la-conception-des-processeurs-universels-prodigy-a-192-coeurs","status":"publish","type":"post","link":"https:\/\/www.ecinews.fr\/fr\/tachyum-fait-passer-la-conception-des-processeurs-universels-prodigy-a-192-coeurs\/","title":{"rendered":"Tachyum fait passer la conception des processeurs universels Prodigy \u00e0 192 c\u0153urs"},"content":{"rendered":"

Le concepteur slovaque de puces pour centres de donn\u00e9es Tachyum a augment\u00e9 le nombre de c\u0153urs de son processeur universel Prodigy, en le faisant passer \u00e0 192, \u00e0 la suite d’un transfert vers un fournisseur d’EDA.<\/h3>\n

Tachyum a notamment poursuivi Cadence Design Systems au sujet de la propri\u00e9t\u00e9 intellectuelle qu’elle a utilis\u00e9e dans une version ant\u00e9rieure comportant 128 des c\u0153urs brevet\u00e9s bas\u00e9s sur deux unit\u00e9s vectorielles de 1024 bits et un processeur matriciel de 4096.<\/p>\n

Apr\u00e8s avoir remplac\u00e9 les IP, l’\u00e9quipe de conception de Prodigy a \u00e9galement d\u00fb remplacer les outils de simulation RTL et de conception physique. Le nouvel ensemble d’outils EDA d’un fournisseur anonyme a permis aux concepteurs d’ajouter plus de c\u0153urs et plus d’interfaces s\u00e9rie\/d\u00e9s\u00e9rialiseur (SERDES), passant de 64 \u00e0 96 sur chaque puce.<\/p>\n

L’entreprise utilise d\u00e9sormais la propri\u00e9t\u00e9 intellectuelle d’Alphawave et de Rambus, dont la propri\u00e9t\u00e9 intellectuelle physique a \u00e9t\u00e9 vendue \u00e0 Cadence. Elle a utilis\u00e9 la biblioth\u00e8que logique DesignWare IP de Synopsys et les moniteurs et capteurs PVT DesignWare de Moortec tout au long de la conception.<\/p>\n

Les prochaines \u00e9tapes consisteront \u00e0 achever la conception du substrat et du socle pour accueillir les lignes SERDES suppl\u00e9mentaires, mais la livraison des premiers processeurs haute performance Prodigy reste pr\u00e9vue pour la fin de l’ann\u00e9e, selon l’entreprise.<\/p>\n

Les c\u0153urs suppl\u00e9mentaires ont entra\u00een\u00e9 une augmentation minimale de la taille de la puce, qui est pass\u00e9e de 500 mm2 \u00e0 600 mm2 pour tenir compte de l’am\u00e9lioration des capacit\u00e9s physiques. Tachyum pourrait ajouter d’autres c\u0153urs tr\u00e8s efficaces tout en respectant la limite de 858 mm2, mais ces c\u0153urs seraient limit\u00e9s en termes de bande passante, m\u00eame avec 16 contr\u00f4leurs DDR5 fonctionnant \u00e0 plus de 7200MT\/s.<\/p>\n

\u00ab\u00a0Nous avons obtenu de meilleurs r\u00e9sultats et une meilleure synchronisation avec nos nouveaux outils EDA PD. Bien que nous n’ayons pas eu d’autre choix que de changer d’outils EDA, notre \u00e9quipe de conception physique (PD) a travaill\u00e9 dur pour refaire la conception physique et les optimisations avec le nouvel ensemble d’outils PD, alors que nous approchons de la production en volume\u00a0\u00bb, a d\u00e9clar\u00e9 le Dr Radoslav Danilak, fondateur et PDG de Tachyum (ci-dessus).<\/p>\n

Parmi les autres am\u00e9liorations r\u00e9alis\u00e9es au cours de la phase de conception physique, citons l’augmentation de la m\u00e9moire cache L2\/L3 de 128 Mo \u00e0 192 Mo et la prise en charge de la m\u00e9moire DDR5 7200 plus rapide que la DDR5 6400. Un bo\u00eetier plus grand peut accueillir 32 liaisons s\u00e9rie suppl\u00e9mentaires et jusqu’\u00e0 32 modules DIMM connect\u00e9s \u00e0 une seule puce Prodigy.<\/p>\n

Un processeur universel<\/strong><\/p>\n

Tachyum d\u00e9crit Prodigy comme un processeur universel capable de passer de mani\u00e8re transparente et dynamique des t\u00e2ches normales de l’unit\u00e9 centrale aux charges de travail de l’IA\/ML, ce qui lui permet d’offrir des performances \u00e9lev\u00e9es en mati\u00e8re d’IA\/ML, tant pour l’apprentissage que pour l’inf\u00e9rence. L’entreprise souligne que l’IA\/ML est de plus en plus importante dans le secteur bancaire et qu’elle est utilis\u00e9e pour identifier les fraudes et les cyberattaques avant qu’elles ne causent de graves dommages financiers.<\/p>\n

R\u00e9duire les co\u00fbts<\/strong><\/p>\n

L’architecture vise \u00e0 r\u00e9duire les co\u00fbts d’exploitation et d’investissement des op\u00e9rateurs de centres de donn\u00e9es, notamment en raison des p\u00e9nuries de GPU de Nvidia qui entra\u00eenent des co\u00fbts plus \u00e9lev\u00e9s, car la puce peut \u00eatre utilis\u00e9e \u00e0 la fois pour des applications de haute performance et des applications grand public. La puce est jusqu’\u00e0 quatre fois plus performante que les principales puces x86, trois fois plus performante que le GPU le plus performant pour le calcul intensif et six fois plus performante pour les applications d’intelligence artificielle.\u00a0Toutefois, cela n\u00e9cessite une nouvelle couche logicielle, qui a \u00e9t\u00e9 certifi\u00e9e sur un FPGA pour ex\u00e9cuter le code des processeurs x86, ARM et RISC-V utilis\u00e9s dans les centres de donn\u00e9es.<\/p>\n

Tachyum<\/a><\/p>\n

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