{"id":427914,"date":"2023-07-24T18:53:08","date_gmt":"2023-07-24T16:53:08","guid":{"rendered":"https:\/\/www.eenewseurope.com\/?p=427914"},"modified":"2023-07-24T18:53:08","modified_gmt":"2023-07-24T16:53:08","slug":"coeur-risc-v-4-voies-personnalisable-pour-le-big-data","status":"publish","type":"post","link":"https:\/\/www.ecinews.fr\/fr\/coeur-risc-v-4-voies-personnalisable-pour-le-big-data\/","title":{"rendered":"C\u0153ur RISC-V 4 voies personnalisable pour le big data"},"content":{"rendered":"<h4>Semidynamics, en Espagne, a mis au point un noyau RISC-V 64 bits \u00e0 4 voies personnalisable pour les puces des centres de donn\u00e9es.<\/h4>\n<p>Le noyau RISC-V Atrevido 423 poss\u00e8de un large pipeline \u00e0 4 voies pour le d\u00e9codage et le retrait de deux fois plus d&rsquo;instructions que le noyau 223 \u00e0 2 voies pr\u00e9c\u00e9dent. Il est \u00e9galement coupl\u00e9 \u00e0 un plus grand nombre d&rsquo;unit\u00e9s fonctionnelles, ce qui augmente consid\u00e9rablement le d\u00e9bit d&rsquo;instructions par cycle (IPC).<\/p>\n<p>Atrevido peut \u00eatre configur\u00e9 comme un c\u0153ur coh\u00e9rent avec un NoC CHI ou comme un c\u0153ur incoh\u00e9rent plus simple connect\u00e9 via une interface AXI. Gr\u00e2ce \u00e0 une TLB et une MMU am\u00e9lior\u00e9es et \u00e0 la prise en charge des SV39\/48\/57, le noyau est bien adapt\u00e9 \u00e0 l&rsquo;ex\u00e9cution d&rsquo;applications utilisant Linux avec de grandes empreintes de m\u00e9moire.<\/p>\n<p>Le noyau Out-Of-Order est livr\u00e9 avec un large menu d&rsquo;extensions RISC-V qui peuvent \u00eatre ajout\u00e9es. Il peut notamment \u00eatre configur\u00e9 avec l&rsquo;unit\u00e9 vectorielle interne, qui prend enti\u00e8rement en charge la derni\u00e8re sp\u00e9cification vectorielle RISC-V.<\/p>\n<ul>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/spanish-startup-performs-risc-v-open-core-surgery\/\">Une entreprise espagnole r\u00e9alise une chirurgie \u00e0 c\u0153ur ouvert RISC-V<\/a><\/li>\n<\/ul>\n<p>La cl\u00e9 de la personnalisation est une grande unit\u00e9 vectorielle avec jusqu&rsquo;\u00e0 2048b de calcul par cycle pour le traitement des donn\u00e9es. L&rsquo;unit\u00e9 vectorielle est compos\u00e9e de plusieurs \u00ab\u00a0c\u0153urs vectoriels\u00a0\u00bb, \u00e0 peu pr\u00e8s \u00e9quivalents \u00e0 un c\u0153ur de GPU, qui effectuent plusieurs calculs en parall\u00e8le. Chaque noyau vectoriel poss\u00e8de des unit\u00e9s arithm\u00e9tiques capables d&rsquo;effectuer des op\u00e9rations d&rsquo;addition, de soustraction, de multiplication-addition fusionn\u00e9e, de division, de racine carr\u00e9e et des op\u00e9rations logiques.<\/p>\n<p>Le noyau vectoriel peut \u00eatre adapt\u00e9 pour prendre en charge diff\u00e9rents types de donn\u00e9es : FP64, FP32, FP16, BF16, INT64, INT32, INT16 ou INT8, en fonction du domaine d&rsquo;application vis\u00e9 par le client. La plus grande taille du type de donn\u00e9es en bits d\u00e9finit la largeur du noyau du vecteur ou ELEN. Les clients choisissent ensuite le nombre de c\u0153urs vectoriels \u00e0 mettre en \u0153uvre dans l&rsquo;unit\u00e9 vectorielle, soit 4, 8, 16 ou 32 c\u0153urs, ce qui permet d&rsquo;obtenir un tr\u00e8s large \u00e9ventail d&rsquo;options de compromis entre puissance, performances et surface. Une fois ces choix effectu\u00e9s, la largeur totale du chemin de donn\u00e9es de l&rsquo;unit\u00e9 vectorielle, ou DLEN, est \u00e9gale \u00e0 ELEN x nombre de c\u0153urs vectoriels. Semidynamics supporte les configurations DLEN de 128b \u00e0 2048b.<\/p>\n<ul>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/tailor-made-risc-v-performance-eenews-interview-with-roger-espasa-semidynamics\/\">Des performances RISC-V sur mesure<\/a><\/li>\n<li><a href=\"https:\/\/www.eenewseurope.com\/en\/semidynamics-launches-configurable-risc-v-vector-unit\/\">Semidynamics lance une unit\u00e9 vectorielle RISC-V configurable <\/a><\/li>\n<\/ul>\n<p>Le c\u0153ur offre \u00e9galement un deuxi\u00e8me choix cl\u00e9 dans l&rsquo;unit\u00e9 vectorielle : le nombre de bits de chaque registre vectoriel (connu sous le nom de VLEN) peut \u00e9galement \u00eatre adapt\u00e9 aux besoins du client. Alors que la plupart des autres fournisseurs partent du principe que le VLEN est \u00e9gal au DLEN (c&rsquo;est-\u00e0-dire un rapport de 1X), Semidynamics propose des rapports de 2X, 4X et 8X. Lorsque le VLEN est plus grand que le DLEN, l&rsquo;ex\u00e9cution d&rsquo;une op\u00e9ration vectorielle n\u00e9cessite plusieurs cycles. Par exemple, lorsque VLEN=2048 et DLEN=512, l&rsquo;ex\u00e9cution de chaque op\u00e9ration arithm\u00e9tique vectorielle prend quatre horloges. Il s&rsquo;agit d&rsquo;une fonctionnalit\u00e9 tr\u00e8s utile pour tol\u00e9rer des temps de latence importants dans la m\u00e9moire et pour r\u00e9duire la consommation d&rsquo;\u00e9nergie.<\/p>\n<p>Les autres extensions sont la manipulation de bits, la cryptographie, les FP en simple pr\u00e9cision, les FP en double pr\u00e9cision et les FP en demi-pr\u00e9cision, ainsi que bfloat16. Les clients peuvent \u00e9galement choisir de prot\u00e9ger le cache de donn\u00e9es avec ECC et le cache d&rsquo;instructions avec parit\u00e9, si cela est n\u00e9cessaire pour leurs march\u00e9s cibles. En outre, le c\u0153ur d&rsquo;Atrevido est enti\u00e8rement conforme au dernier profil RISC-V RVA22. Les noyaux ne d\u00e9pendent pas du process de fabrication, des versions \u00e9tant d\u00e9j\u00e0 fournies jusqu&rsquo;\u00e0 5 nm.<\/p>\n<p>\u00ab\u00a0L&rsquo;Atrevido 423 est particuli\u00e8rement bien adapt\u00e9 aux applications qui requi\u00e8rent des quantit\u00e9s massives de donn\u00e9es. Il brille lorsque les donn\u00e9es requises ne peuvent pas \u00eatre stock\u00e9es dans des niveaux de hi\u00e9rarchie de m\u00e9moire plus proches du c\u0153ur (tels que L1, L2 ou m\u00eame L3) en tol\u00e9rant de tr\u00e8s grandes latences sans compromettre le d\u00e9bit gr\u00e2ce \u00e0 notre technologie Gazzillion misses\u00a0\u00bb, a d\u00e9clar\u00e9 Roger Espasa, PDG de Semidynamics.<\/p>\n<p>\u00ab\u00a0Il peut traiter jusqu&rsquo;\u00e0 128 demandes simultan\u00e9es de donn\u00e9es et les suivre jusqu&rsquo;au bon endroit, quel que soit l&rsquo;ordre dans lequel elles sont renvoy\u00e9es. Gazzillion permet au c\u0153ur d&rsquo;acc\u00e9der \u00e0 des niveaux hi\u00e9rarchiques de m\u00e9moire tr\u00e8s \u00e9loign\u00e9s du c\u0153ur sans impact sur la bande passante ou le d\u00e9bit. En effet, la technologie Gazzillion \u00e9limine les probl\u00e8mes de latence qui peuvent survenir lors de l&rsquo;utilisation de la technologie CXL pour permettre \u00e0 la m\u00e9moire \u00e9loign\u00e9e d&rsquo;\u00eatre acc\u00e9d\u00e9e aux taux suraliment\u00e9s qu&rsquo;elle a \u00e9t\u00e9 con\u00e7ue pour fournir. Atrevido est ainsi tr\u00e8s bien positionn\u00e9 pour g\u00e9rer les charges de travail d&rsquo;IA et de HPC, qui ont g\u00e9n\u00e9ralement besoin d&rsquo;acc\u00e9der rapidement \u00e0 de tr\u00e8s grandes quantit\u00e9s de donn\u00e9es \u00e0 partir de la m\u00e9moire principale.\u00a0\u00bb<\/p>\n<p>L&rsquo;extension cryptographique scalaire mise en \u0153uvre suit la derni\u00e8re sp\u00e9cification (Zks et Zk) et fournit un chiffrement de haute performance pour des algorithmes tels que SHA2-256, SHA2-512, ShangMi 3, ShangMi 4, AES-128, AES-192, et AES-256. L&rsquo;impl\u00e9mentation en temps constant de l&rsquo;Atrevido 423 offre une s\u00e9curit\u00e9 contre les attaques par canal lat\u00e9ral tout en fournissant une solution cryptographique de haute performance.<\/p>\n<p>\u00ab\u00a0Semidynamics poss\u00e8de les c\u0153urs les plus rapides du march\u00e9 pour d\u00e9placer de grandes quantit\u00e9s de donn\u00e9es avec une ligne de cache par horloge \u00e0 des fr\u00e9quences \u00e9lev\u00e9es, m\u00eame lorsque les donn\u00e9es ne tiennent pas dans le cache. Et cela peut se faire \u00e0 des fr\u00e9quences allant jusqu&rsquo;\u00e0 2,4 GHz sur le bon n\u0153ud. Le reste du march\u00e9 propose en moyenne une ligne de cache tous les tr\u00e8s nombreux cycles, ce qui est loin d&rsquo;\u00eatre le cas de Semidynamics, qui propose une ligne de cache par cycle\u00a0\u00bb, a d\u00e9clar\u00e9 M. Espasa.<\/p>\n<p><a href=\"https:\/\/r20.rs6.net\/tn.jsp?f=001RQbijZiCwrkKMVKY1g0fOpAVqpLYdIHI7fFtZprXC4tCkxT8KlwrNbUfuvYxQGNb_Lx0AmTSagsdoUjVDTf5KwVjyVm8Imm7StjzWm9-CQMxRMBDmfo2naQfRu-d1OuqmroNdEJ6tGDSTFmkqRPOeg==&amp;c=S9IuvcMtkbvlNshKHMvt5oSDoOwbs829dy22UqKQu8OpexkDep4rvw==&amp;ch=QXgYqr8KsO2h3WHKkVwENA7uFAVI_-XBXhU-i8W15MkdYMJVZwgR1A==\">www.semidynamics.com<\/a><\/p>\n","protected":false},"excerpt":{"rendered":"<p>Semidynamics, en Espagne, a mis au point un noyau RISC-V 64 bits \u00e0 4 voies personnalisable pour les puces des centres de donn\u00e9es. Le noyau RISC-V Atrevido 423 poss\u00e8de un large pipeline \u00e0 4 voies pour le d\u00e9codage et le retrait de deux fois plus d&rsquo;instructions que le noyau 223 \u00e0 2 voies pr\u00e9c\u00e9dent. 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